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处理器及微控制器/DSP数字信号处理器/TMS320DM643AZDK6

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  • TMS320DM643AZDK6
    在售
    FCBGA (ZDK)-548
    TMS320DM643AZDK6DATASHEET
    L103946595
    商品类目 DSP数字信号处理器
    品牌 TI(德州仪器)
    封装规格 FCBGA (ZDK)-548
    包装 托盘
    类型 定点
    接口 主机接口,I²C,McASP,McBSP
    时钟速率 600MHz
    非易失性存储器 外部
    片载RAM 288kB
    电压-I/O 3.30V
    电压-内核 1.40V
    工作温度 0℃~90℃(TC)
    安装类型 表面贴装型
    基本产品编号 TMS320
    RoHS状态 不符合RoHS规范
    湿气敏感性等级(MSL) 4(72小时)
    REACH状态 REACH产品
    ECCN 3A991A2
    HTSUS 8542.31.0001
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    TMS320C64x DSP(包括 TMS320DM643 器件)是 TMS320C6000 DSP 平台中性能最高的定点 DSP 系列。 TMS320DM643 (DM643) 器件基于德州仪器 (TI) 开发的第二代高性能、先进的 VelociTI 超长指令字 (VLIW) 架构 (VelociTI.2),使这些 DSP 成为数字媒体应用。 C64x 是 C6000 DSP 平台的代码兼容成员。 DM643 器件在 600 MHz 的时钟频率下具有高达每秒 48 亿条指令 (MIPS) 的性能,可为高性能 DSP 编程挑战提供经济高效的解决方案。 DM643 DSP具有高速控制器的操作灵活性和阵列处理器的数值能力。 C64x DSP 核心处理器具有 64 个 32 位字长的通用寄存器和 8 个高度独立的功能单元——两个用于 32 位结果的乘法器和六个算术逻辑单元 (ALU)——具有 VelociTI.2 扩展。八个功能单元中的 VelociTI.2 扩展包括新指令,可加速视频和成像应用程序的性能并扩展 VelociTI 架构的并行性。 DM643 可以在每个周期产生四个 16 位乘法累加 (MAC),总计每秒 24 亿个 MAC (MMACS),或者每个周期产生八个 8 位 MAC,总计 4800 个 MMACS。 DM643 DSP 还具有与其他 C6000 DSP 平台器件类似的专用硬件逻辑、片上存储器和附加片上外设。 DM643 使用基于两级缓存的架构,并具有功能强大且多样化的外设集。一级程序高速缓存 (L1P) 是 128-Kbit 直接映射高速缓存,一级数据高速缓存 (L1D) 是 128-Kbit 2 路组关联高速缓存。 2 级内存/高速缓存 (L2) 由一个 2 Mbit 的内存空间组成,在程序和数据空间之间共享。 L2 内存可以配置为映射内存、缓存或两者的组合。外设集包括: 两个可配置的视频端口 一个 10/100 Mb/s 以太网 MAC (EMAC) 一个管理数据输入/输出 (MDIO) 模块 一个 VCXO 内插控制端口 (VIC) 一个多通道缓冲音频串行端口 (McASP0) 一个接口- 集成电路 (I2C) 总线模块 一个多通道缓冲串行端口 (McBSP) 三个 32 位通用定时器 一个用户可配置的 16 位或 32 位主机端口接口 (HPI16/HPI32) 一个 16 针通用-具有可编程中断/事件生成模式的专用输入/输出端口 (GP0) 和 64 位无缝外部存储器接口 (EMIFA),能够连接到同步和异步存储器和外设。 DM643 器件具有两个可配置的视频端口外设(VP1 和 VP2)。这些视频端口外设为常见的视频解码器和编码器设备提供无缝接口。 DM643 视频端口外设支持多种分辨率和视频标准(例如,CCIR601、ITU-BT.656、BT.1120、SMPTE 125M、260M、274M 和 296M)。这两个视频端口外设是可配置的,可以支持视频捕获和/或视频显示模式。每个视频端口包含两个通道 - A 和 B,带有一个 5120 字节的捕获/显示缓冲区,可在两个通道之间拆分。有关视频端口外设的更多详细信息,请参阅 TMS320C64x DSP 视频端口/VCXO 插值控制 (VIC) 端口参考指南(文献编号 SPRU629)。 McASP0 端口支持一个发送和一个接收时钟区域,带有八个串行数据引脚,可以单独分配给两个区域中的任何一个。串行端口支持从 2 到 32 个时隙的每个引脚上的时分复用。 DM643 有足够的带宽来支持所有 8 个串行数据引脚传输 192-kHz 立体声信号。每个区域中的串行数据可以在多个串行数据引脚上同时发送和接收,并以飞利浦 IC 间声音 (I2S) 格式的多种变体进行格式化。此外,McASP0 发射器可以编程为同时输出多个 S/PDIF、IEC60958、AES-3、CP-430 编码数据通道,单个 RAM 包含用户数据和通道状态字段的完整实现。 McASP0 还提供广泛的错误检查和恢复功能,例如每个高频主时钟的坏时钟检测电路,它验证主时钟是否在编程的频率范围内。 VCXO 插值控制 (VIC) 端口提供分辨率从 9 位到高达 16 位的数模转换。 VIC 的输出是单比特内插 D/A 输出。有关 VIC 端口的更多详细信息,请参阅 TMS320C64x DSP 视频端口/VCXO 内插控制 (VIC) 端口参考指南(文献编号 SPRU629)。以太网媒体访问控制器 (EMAC) 在 DM643 DSP 核心处理器和网络之间提供了一个高效的接口。 DM643 EMAC 支持 10Base-T 和 100Base-TX,或半双工或全双工的 10 Mbits/秒 (Mbps) 和 100 Mbps,具有硬件流控制和服务质量 (QOS) 支持。 DM643 EMAC 利用 DSP 内核的自定义接口,可实现高效的数据传输和接收。有关 EMAC 的更多详细信息,请参阅 TMS320C6000 DSP 以太网媒体访问控制器 (EMAC)/管理数据输入/输出 (MDIO) 模块参考指南(文献编号 SPRU628)。管理数据输入/输出 (MDIO) 模块不断轮询所有 32 个 MDIO 地址,以便枚举系统中的所有 PHY 设备。一旦 DSP 选择了 PHY 候选者,MDIO 模块就会通过读取 PHY 状态寄存器来透明地监控其链路状态。链接更改事件存储在 MDIO 模块中,并且可以选择性地中断 DSP,从而允许 DSP 轮询设备的链接状态,而无需连续执行昂贵的 MDIO 访问。有关 MDIO 的更多详细信息,请参阅 TMS320C6000 DSP 以太网媒体访问控制器 (EMAC)/管理数据输入/输出 (MDIO) 模块参考指南(文献编号 SPRU628)。 TMS320DM643 上的 I2C0 端口允许 DSP 轻松控制外围设备并与主机处理器通信。此外,标准多通道缓冲串行端口 (McBSP) 可用于与串行外围接口 (SPI) 模式外围设备进行通信。 DM643 拥有一套完整的开发工具,其中包括:一个新的 C 编译器、一个用于简化编程和调度的汇编优化器,以及一个用于查看源代码执行的 Windows 调试器接口。
    封装:NFBGA-361
    产品状态:在售
    封装:LQFP (PZ)-100
    产品状态:在售
    封装:FCBGA (ZDK)-548
    产品状态:在售
    封装:LQFP (PGE)-144
    产品状态:停产
    封装:FCBGA (CUT)-529
    产品状态:在售
    封装:NFBGA (ZWT)-361
    产品状态:不适用于新设计
    封装:NFBGA (ZWT)-361
    产品状态:在售
    封装:FCBGA (ZNZ)-548
    产品状态:在售
    封装:FCBGA (ZDK)-548
    产品状态:在售
    封装:FCBGA (CUT)-529
    产品状态:在售
    封装:FCBGA (CUT)-529
    产品状态:不适用于新设计
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